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DS878也是種高速的直接性數碼聚合器（DDS），速度調諧辨別好壞比比率32位，ROM相位辨別好壞比比率13位，DAC波幅辨別好壞比比率11位。DAC的養成仿真改變的可在一切日常做到著方法（用到一號奈奎斯特頻譜）和回零方法（用到一號、第2和3、奈奎斯特頻譜）操作流程范圍內采用。在DAC的一切日常做到著方法下，可引發達到1.8GHz左右的一號奈奎斯特頻譜（以3.6GHz的掛鐘速度），或在DAC的回零方法下引發達到5.4GHz的3、奈奎斯特頻譜。開啟相位還可以初始化為零度以下開啟。該集成塊全是對相容的養成仿真改變的，暗含50-∧的上面POS機終端顧客。改變的弧形的速度可由33個速度保持位Vi[0:31]保持。DS878可連受差分掛鐘鍵盤插入或單端掛鐘鍵盤插入，包括50-∧片上完之后端POS機終端顧客和顧客概念的閥值。速度辨別好壞率位接收LVTTL或CMOS鍵盤插入電平。差分同歩鍵盤插入SyncI_P/N為二個集成塊應該用出示同歩，并啟動的每臺集成塊籌備 好接收速度字鍵盤插入。同歩選通鍵盤插入由組織結構引發的除于8掛鐘的分層邊鎖存，這樣掛鐘也被發布到改變的引腳SyncO_P/N。SyncO_P/N能以為對比，將速度字和閃爍數據信息鍵盤插入隨機對同歩到組織結構除于6個掛鐘，以正確合理鎖存。初始化是異步的，以最低化養成仿真改變的有效的性的掛鐘超時。對組織結構隨機通過了優化方案，以不要在速度字改變的時候或初始化后掛鐘打滑的現象。只需要某個-5V電源線。

通常特別?32位率調諧字?13位ROM相位地址查詢辯別率?片上11位DAC?鐘表頻次達到4.5 GHz?模擬網輸出精度可在正常情況保持著文件類型和回零文件類型相互間取舍?余弦波導致高至2.25 GHz的第一名奈奎斯特頻段用到普通恢復模式英文，或6.75 GHz第一奈奎斯特k線用到清零模式英文，。?在4 GHz石英鐘傳輸率下，網絡上行速率較差SFDR取決于50 dBc（直流變壓器至2 GHz上行速率）?帶50?側面終下同質模擬系統正弦波形輸入?關聯P/N關聯很多個存儲芯片APP?SyncO_P/N為參數訪問和微信同步選通訊技術號提拱參照。?LVTTL/CMOS字母玩法的控制輸出?異步歸位（RST）引腳重新開機0相（IQSL=低）或90（IQSL=高）重新開機方式?選通放入（STRB U P/N），以提升幀率字和DAC轉換幀率?寬數據庫數據加載對話框能接受DS878由存儲器器、微把控器、FPGA或DSP電源芯片把控，以最怏5個鐘表生長期的更新的的頻率字，而不想在的的頻率轉變前三天誕生鐘表滾輪或錯誤碼?單獨-5V電的功耗測試為4.3W?64針QFN 9x9打包封裝